标准DRAM芯片结构分成两组以减少输入地址引脚的数量，提高封装的效率。虽然在标准的DRAM结构中，输入地址引脚的数量可以通过安排多元的地址方式来减少，但是这样的话，标准DRAM存储单元的时钟控制就会变得更加复杂，同时运行速度会受到影响。为了满足对于高速DRAM应用的需求，一般都用分开的地址输入引脚来减少时钟控制的复杂性和提高运行速度。